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목록SR Latch (2)
거북이처럼 천천히
SR Latch / D Latch / D Flip Flop
1. Behavioral modeling of SR Latch with clcok (Positive edge sensitive)// Behavioral modeling of SR Latchmodule Behavioral_modeling_of_SR_Latch_Positive_edge( input s, r, input clk, enable, reset, output reg q ); always @(*) begin if(reset) q = 0; else if(enable) begin if(clk==1 && s==1 && r==0) q = 1; else if(clk==1 && s==0 && r==1) q = 0; ..
SR Latch / D Latch
1. Sequential logic circuitFlip Flop과 Latch는 디지털 논리 회로에서 1bit 값을 저장할 수 있는 순차논리 회로이다.Combinational logic circuit은 현재의 입력값에 의해서만 출력값이 결정되는 논리회로 이지만,Sequential logic circuit은 현재의 입력값 뿐만아니라 전단의 과거 상태 의해서 출력값이 결정되는 논리 회로이다.Sequential logic circuit은 Feedback 회로를 가지며, 이를 통해 출력이 논리 동작에 영향에 미친다. 2. Latch와 Flip-FlopFlip-Flop과 Latch 는 1bit 값을 저장할 수 있는 순차 논리 회로이지만, 차이점을 갖는다.Latch : Level sensitive 에서 동작하는..